Datasheet Texas Instruments CDC3S04YFFR — Даташит
Производитель | Texas Instruments |
Серия | CDC3S04 |
Модель | CDC3S04YFFR |

Четверной синусоидальный тактовый буфер с LDO 20-DSBGA от -40 до 85
Datasheets
CDC3S04 Quad Sine-Wave Clock Buffer with LDO. datasheet
PDF, 1.5 Мб, Версия: C, Файл опубликован: 25 июл 2012
Выписка из документа
Статус
Статус продукта | В производстве (Рекомендуется для новых разработок) |
Доступность образцов у производителя | Да |
Корпус / Упаковка / Маркировка
Pin | 20 |
Package Type | YFF |
Industry STD Term | DSBGA |
JEDEC Code | R-XBGA-N |
Package QTY | 3000 |
Carrier | LARGE T&R |
Маркировка | CDC3S04 |
Thickness (мм) | .4 |
Pitch (мм) | .4 |
Max Height (мм) | .625 |
Mechanical Data | Скачать |
Параметры
Additive RMS Jitter(Typ) | 300 fs |
Input Frequency(Max) | 52 МГц |
Input Level | SINE |
Количество выходов | 4 |
Рабочий диапазон температур | от -40 до 85 C |
Output Frequency(Max) | 52 МГц |
Output Level | SINE |
Package Group | DSBGA |
Package Size: mm2:W x L | See datasheet (DSBGA) PKG |
Rating | Catalog |
VCC Out | 1.8 В |
Экологический статус
RoHS | Совместим |
Комплекты разработчика и оценочные наборы
- Evaluation Modules & Boards: CDC3S04EVM
CDC3S04EVM Evaluation Module
Статус продукта: В производстве (Рекомендуется для новых разработок)
Application Notes
- Using the CDC3S04PDF, 110 Кб, Файл опубликован: 18 апр 2010
When designing a single-ended clock tree, a system designer can choose between two commonly-used waveform types: rectangular or sinusoidal. This application note gives a short overview of both signal types and shows the advantages and disadvantages of each using the CDC3S04 quad sine-wave clock buffer with an integrated low-dropout regulator (LDO). Additionally, the clipped sinusoidal waveform is - Power Supply Rejection to Noise in Sinusoidal Clock Buffers: CDC3S04 (Rev. A)PDF, 12.8 Мб, Версия: A, Файл опубликован: 21 июн 2010
This application report is an overview on how power supply noise affects some key specifications of the CDC3S04 sine wave buffer. The ripple in the power supply induces additional harmonics in the frequency spectrum and spurs in the phase noise plot, thus degrading the overall jitter and EMI performance. Decoupling capacitors significantly minimize these effects. This document provides guidelines
Модельный ряд
Серия: CDC3S04 (1)
- CDC3S04YFFR
Классификация производителя
- Semiconductors > Clock and Timing > Clock Buffers > Single-Ended